Chisel

Chisel(Constructing Hardware In a Scala Embedded Language)是伯克利大学(UC Berkeley)开发的一种开源硬件构造语言。它是建构在 Scala 语言之上的领域专用语言(DSL),支持高度参数化的硬件生成器,通过使用高度化的参数生成器和分层的专用硬件设计语言来支持高级硬件设计。

采用 Chisel 设计的电路经过编译,可以得到针对 FPGA、ASIC 的 Verilog HDL 代码。

下面是一段用 Chisel 写的 Hello World 程序。

object HelloScala extends App{
    println("Hello Chisel World!")
}

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